序號
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課
程 名
稱 |
培
訓 目
標 |
近開課時間
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學
期 |
芯片、集成電路設計系列培訓班
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K1 |
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混合信號驗證平臺ADMS培訓 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K2 |
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Cadence模擬電路前端設計培訓 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K3 |
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九天EDA工具培訓 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K4 |
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Synopsys DesignWare Library and DesignWare AMBA VIP培訓 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K5 |
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Mentor FPGA設計培訓 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K6 |
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Synopsys Power Compile培訓 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K7 |
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Synopsys綜合培訓班 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K8 |
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高級SOC版圖設計(P&R)方法培訓 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K9 |
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IC版圖/數(shù)字IC設計技巧高級班 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K10 |
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Cadence NC Sim 培訓 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K11 |
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集成電路版圖設計師培訓班 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K12 |
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Synopsys SystemVerilog驗證培訓 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K13 |
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RTL Synthesis(Design Synthesis)培訓 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K14 |
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Design Sign-Off培訓 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K15 |
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Physical Design Implementation培訓課程 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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K16 |
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DFM&TCAD培訓課程 |
2025年2月17日....................(歡迎您垂詢,視教育質(zhì)量為生命!) |
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